赛灵思推出两款开发环境软件能配合多种系统级设计工具

 服务一类     |      2019-03-07 10:09

  近期新增了两款SDx 开发环境系列成员。新推出的SDAccel 开发环境使没有任何FPGA经验的数据中心设备编程员都能够运用OpenCL、C 或C++ 语言针对数据中心和云计算基础设施对赛灵思FPGA进行编程,设计出的FPGA 设备性能功耗比远超基于的设备。赛灵思还推★◇▽▼•出了SDSoC 开发环境,支持同样没有FPGA 经验的软件开发人员用C 或C++ 语言基于赛灵思及第三方平台开发商推出的Zynq-7000 All Programmable SoC 和UltraScale+

  SDx 环境是赛灵思All Programmable Abstraction 计划的最新产品。该计划旨在帮助软件工程师和系统架构师方便地编程赛灵思器件,同时开发环境可根据他们的需求量身定制。

  “SDNet、SDAccel 与SDSoC 这一完美组合将为系统和软件工程师提供熟悉的类似CPU、GPU 和ASSP 的编程环境,这些工程师将首次尽享All Programmable 器件带来的独特优势,诸如定制加速功能,性能功耗比提升10 倍乃至100 倍,任意设备件间连接,以及提供下一代智能系统所需的保密性和安全性。赛灵思正力助下一代系统做到进一步互联,实现软件定义和虚拟化,同时还必须支持基于软件的分析,更多云端计算功能,这通常是无处不在的视频和嵌入式视觉应用所需要的。这就要求SDx 软件定义编程环境和异构多处理技术采用新型UltraScale FPGA 和MPSoC。”

  这些All Programmable 器件比赛灵思早些年的胶合逻辑FPGA 高级得多,实现了任何其他架构所无法企及的系统功能和最终产品差异化。为了最大化这些最新器件的价值,在竞争中脱颖而出,管理层认识到赛灵思必须开▼▼▽●▽●发出相关工具和方法,帮助系统架构师乃至嵌入式软件开发员(而▪•★仅仅只有FPGA 专家),去进行赛灵思最新器件的编程工作。此外,公司还必须针对高增长市场,为软件工程师开发出设计环境,并根据设计人员习惯使用的工具和流程来定制这些环境。此外,加强与MathWorks和国家仪器(Nl)等公司联盟也势在必行,这些公司已经构建了各种环境,使非传统FPGA 用户能够充分利用赛灵思All Programmable 器件的功率效率和灵活性优势。

  对老客户来说,如果能为设计团队的每个成员都提供相应的设计环境,那就能确保高效性,缩短产品上市时间。如果这些环境足够▷•●高级,就能真正推广All Programmable FPGA 和Zynq SoC 设计,让那些没有FPGA 设计经验的架构师和软件工程师无需硬件设计人员帮助就能进行器件编程。全球软件工程师人数与硬件工程师人数比为10:1。因此,提供这种开发环境(或支持这种开发环境的硬件平台)的赛灵思及其联盟计划合作伙伴既能扩大用户群,又能增加营收。

  该战略和支持软件工程师及系统架构师利用根据其设计需求量身定做的环境进行赛灵思器件编程的后续开发工作就是赛灵思所谓的All Programmable Abstraction(如图 所示)。

  设计抽象迈出了重大的第一步,那就是赛灵思收购了私企AutoESL 公司的高层次综合(HLS)工具。继并购之后,赛灵思于2012 年公开发布了集成到ISE 设计套件和Vivado 设计套件工具流程中的HLS技术。根据Berkeley Design Automation的详细调研(结果表明AutoESL 的HLS 工具最简便易用,而且是EDA产业所有HLS 工具中能提供最佳结果质量的HLS),赛灵思选择了AutoESL技术。HLS 源于EDA 世界,这也意味着工具使用模型面向的是ASSP 和片上系统△▪▲□△(SoC)架构师以及拥有C 和C++ 编程经验、同时对硬件描述语言(Verilog和VHDL)及芯片设计需求有一定工作了解的成熟设计团队。

  利用Vivado HLS,具有丰富技能的架构师和设计团队能用C 和C++ 创建算法,同时利用Vivado HLS 来编译并转换那些算法为RTL IP 模块。随后,FPGA 设计人员能将这个模块及其它模块集成到创建或授权的RTL 中,并用赛灵思的IP Integrator(IPI)工具将IP 汇编到设计中。随后,FPGA设计人员△▪▲□△能将汇编设计一步步通过Vivado 流程,执行HDL 仿真、时序与功耗优化、布局布线等。最终,设计人员生成网表/ 比特文件并配置目标All Programmable 器件的硬件。如果设计包含处理器(Zynq SoC 或MPU 软核),配置后的器件随即可供嵌入式软件工程师编程。

  为了帮助嵌入式软件工程师应对繁杂的编程工作,赛灵思提供了基于Eclipse 的集成设计环境,即赛灵思软件开发套件(SDK),其包含编辑器、编译器、调试器、驱动程序和面向Zynq SoC 或FPGA 的库,其内嵌了赛灵思的32 位MicroBlazeTM 软核。该SDK 于10 多年前推出,随着赛灵思器件上处理器集成的发展变化而得到了大幅提升,此前器▲●…△件上集成硬化的DSPSlice 和软核MCU和MPU(8位、16 位和32 位),到Virtex-4 和Virtex-5 FPGA 时已转变为集成硬化的32 位PowerPC ;到Zynq SoC 已转化为集成32 位ARM处理器;而到即将推出的Zynq UltraScale+ MPSoC 则发展到集成64 位ARM 处理器。

  10 多年来,赛灵思与国家仪器(NI)和MathWorks 公司一直保持密切合作。这两家公司致力于为其服务的特定用户提供量身定制的独特高级开发环境。

  美国国家仪器(NI)(德克萨斯州奥斯汀)提供的硬件平台深受控制和测试系统创新者欢迎。赛灵思的FPGA和Zynq SoC 为NI RIO 平台提供动力。NI 的LabVIEW开发环境是用户友好型图形化程序,底层运行Vivado设计套件,因此NI 的客户无需了解任何FPGA 设计细节。一些人或许根本不知道RIO 产品的核心其实是赛灵思器件。他们只需在LabVIEW 环境中对其系统编程即可,NI 硬件能提升其开发的设计性能。

  MathWorks(马萨诸塞州纳蒂克),该公司10 多年前为其MATLAB、Simul•☆■▲ink、HDL Coder和Embedded Coder 添加了FPGA 支持,底层运行赛灵思的ISE 和Vivado工具,而且完全自动化。因此,公司的用户—— 主要是数学算法开发人员—— 能开发算法并大幅提升算法性能,而且能在FPG▲★-●A 结构上简便运行算◆●△▼●法。

  10 年前,赛灵思为其ISE 开发环境添加了FPGA 架构级工具—— 系统生成器(System Generator),近期又给Vivado 设计套件添加了,以帮助具备FPGA 知识的团队进一步调节设计,实现算法性能增益。MathWorks 和赛灵思两家公司技术的强强组合,有助于客户公司推出成千上万种创新产品。

  近期,其他公司也开始为赛灵思环境做出贡献。赛灵思近期迎来TOPIC Embedded Systems 和Silicon Software 这两家欧洲公司加入其联盟计划,特别是欢迎其针对医学和工业市场的高级开发环境。

  TOPIC Embedded Systems(荷兰埃因霍温)拥有独特的开发环境DYPLO,《赛灵思中国通讯第54 期》对其进行了详细介绍。该环境面向Zynq SoC,很快也将面向Zynq MPSoC,对系统级设计采用统一方法,从而使系统架构师能够用C 或C++ 创建系统设计结果,并在Zynq SoC 的双核ARM Cortex-A9 处理系统上运行该结果。一旦用户发现设计某些部分在软件中运行太慢,可以将这些部分拖放到窗口中,将C 语言转化为FPGA 逻辑(底层运行Vivado HLS),并将其放入Zynq SoC 的可编程逻辑中。来回交换代码片段,直到达到最佳系统性能。TOPIC 最初用于医疗设备开发,目前也开始与工业设备制造商合作。

  Silicon Software(德国曼海姆)是支持软件工程师利用赛灵思All Programmable 器件的最新联盟成员。公司的VisualApplets 图形图像处理设计环境可帮助面向Zynq SoC 平台的系统架构师和软件工程师打造工业机器视觉应用创新,而且无需硬件工程师的协助。在2013 年SPS Drives 行业展会的赛灵思展台上,Silicon Software展示了其用VisualApplets 环境开发的光学检查系统。演示显示通过采用VisualApplets 环境将图形处理任务从Zynq SoC 的处理系统转交给器件的FPGA 逻辑来执行,能将系统性能提升10 倍。

  借助SDx 软件定义开发环境,赛灵思将面向关键市场的软件开发人员和系统架构师构建一系列高级的设计入门环境。SDAccel 和SDSoC 在底层自动运行整个Vivado 流程,无需直接使用Vivado 工具,也无需硬件工程师的协助。SDNet 不会访问Vivado HLS,针对线路卡架构师,其提供了独特的“两步使用模型”。

  在第一步中,线路卡架构师采用直观的类似C 语言的高级语言而不•□▼◁▼是晦涩的微代码来设计需求,并制定网络线路卡规格◆◁•描述。SDNet 开发环境根据规格描述生成RTL 版设计。流程随后需要硬件工程师在目标FPGA 中实现RTL。

  在第二步中,SDNet 还允许网络公司用高级语言测试和更新协议,并升级线路卡的功能,即便在现场部署后也能做到,而且无需硬件设计参与。这个流程有助于企业快速创建并更新线路卡,这种灵活性对软件定义网络而言非常重要。

  SDAccel 和SDSoc 这两个新设计环境将SDx 的理念推广到新的应用领域。

  《数据中心学刊》(Data Center Journal)2014 年3 月的一篇文章指出,谷歌、Facebook、亚马逊、领英等公司核心部分——数据库——“消耗的电力占全球电力3% 以上,同时产生2 亿公吨二氧化碳”。如此巨大的能耗使得其数据中心一年电费超过600 亿美元。即便对最大规模网络公司来说,功耗也会严重削减盈利性,而且对环境也会产生不可估量的影响。

  随着越来越多的企业期望采用云计算和大数据分析技术;视频和流媒体的全球性普及,以及越来越多的人加入无线G网络,对数量更多、性能更好的数据中心的需求呈几何级无止境增长趋势。《数据中心学刊》文章指出,从当前趋势看,到2017 年数据中心流量预计将达7.7ZB,这意味着数据中心的功耗如果不能得到有效控制将会出现大幅增长。当今大多数数据中心的功耗主要源于其基础组件——Intelx86 处理器。目前MPU 能提供良好但不是最佳的性能,而且功耗很高。

  许多数据中心设备厂商已证实,分立式FPGA结合分立式CPU使用,虽然每个卡的功耗会★▽…◇增加一点点,但性能却得到大幅提升,从而可大幅提升性能功耗比。还有人认为,通过采用一颗在单个SoC上集成x86处理器内核和FPGA逻辑的芯片,有望进一步提升性能功耗比。还有人认为,在单个SoC上集成FPGA逻辑和64位ARM处理器IP似乎能带来更低功耗但同样高性能的解决方案。

  在数据中心使用FPGA 的主要障碍就是编程问题。数据中心开发人员习惯于x86 架构编程,这些开发人员通常只有纯软件编程背景。帮助开发人员将CPU 程序转向更快的GPU 的第一步就是业界OpenCL 语言的开放开发。过去2 年来,OpenCL 取得进一步发展,使客户▪…□▷▷•能够针对FPGA 进行编程,从而为未来数据中心设备架构乃至无所不在网络创造了新的机遇。

  通过推出SDAccel 环境,赛灵思弥补了编程鸿沟,并为数据中心工程师使用OpenCL、C 或C++ 编程FPGA 平台铺平了道路,而且无需硬件工程师介入。赛灵思公司设计方法市场高级总监Tom Feist 表示,针对OpenCL、C 和C++ 的SDAccel 开发环境使数据中心编程人员能够打造出比CPU 和GPU 系统性能功耗比高出25倍的设备。

  Feist 指出,在SDAccel 流程中,x86 CPU 结合运行赛灵思20nm Kintex UltraScale FPGA 的加速卡,软件开发人员能发现需要加速的应用,并用OpenCL 编码和优化内核,再为CPU编译和执行☆△◆▲■应用。随后他们再来评估并调试内核,直到找到周期精确的模型。接下来,再用SDAccel 编译代码,并自动实现在FPGA 中(可能因为Vivado 在底层运行)。随后就能运行应用,验证通过卡加速后的应用性能以及与单纯用CPU 运行的性能对比。Feist 指出:“他们能循环运行迭代,直到找到性能和▪▲□◁功耗之间的最佳平衡,相对于CPU 和G▼▲PU 实现方案,性能功耗比可提升多达25 倍。”

  SDNet 让线卡开发人员能够利用独特的软定义方式快速创建下一代网络,而SDAccel 则能让数据中心设备厂商的下一代数据中心设计的实现最佳性能功耗比。新的SDSoC 开发环境或许能为赛灵思用户○▲-•■□群带来最广泛的影响。这是因为SDSoC 针对广泛的嵌入式系统设计团队,特别是软件工程师,这些软件工程师设计面向的是赛灵思Zynq SoC 所服务的大部分市场。SDSoC 环境现在能让用户配置逻辑—— 不光是对运行Zynq SoC 硬件平台的嵌入式系统处理器编程——而且能使用C 和C++ 语言。

  使用SDSoC 环境,嵌入式软件开发人员能运用C 或C++语言创建设计并进行测试,以发现Zynq SoC 处理系统上哪些部分运行得不佳。一旦发现可疑代码,便突出显示并命令SDSoC 环境自动将该代码分区到Zynq SoC 的可编程逻辑中,以加速系统性能。Nick 指出,SDSoC环境只需点击按钮就能把软件功能移到FPGA 逻辑中,无需硬件工程师介入。SDSoC 中的编译器将生成整个Vivado 项目,并为目标硬件平台生成可引导的软件映像。

  《计算机体系结构—行业篇1》之系统软件开发、运维、测试、灰色产业、IT传统开发

  点击右方佳嵌图标,可以看所有课程。《计算机体系结构》 之 行业篇1主要涉及内容位,计算机科学、系统软件开

  我研究了Zynq-7000架构并发现了EMIO功能:I / O外设信号也可以通过EMIO接口路由到PL(包括PL器件引脚)。 这对于...

  FPGA●中的可编程逻辑块是查找表(LUT),它可以通过编程实现任意布尔函数:4个,5个或6个输入具有....

  对于嵌入式开发软件来说,可以把嵌入式软件开发分成2个工作岗位。一个是应用开发,另一个是底层开发。

  根据新的NIST SP 800 193标准、在硬件上使用基于FPGA的可信根器件来实现平台硬件保护和....

  我现在需要在我的系统上电后,出现一个类似配置界面的东西。用户可以在配置界面中输入一些变量的数据。如何实现使用界面。 &nb...

  他说,一支拥有开发满足汽车功能安全要求的ASIC或SoC所需经验的设计团队可以使用该设备——将eFA....

  AGM方面告诉半导体行业观察(ID:icbank)记者,他们的FPGA产品是国产中达到的最大容量和最....

  FPGA架构与ASIC类似,但与CPLD差异巨大。一个通用的FPGA架构包括配置逻辑块(CLB)阵列....

  根据工艺流程分析控制要求,明确控制任务,拟定◇=△▲控制系统设计的技术条件。技术条件一般以设计任务书的形式来....

  FPGA可能确实很性感(以工程师的说法),但它们并不是唯一的可编程逻辑器件;其它设备也可以用单一设备....

  FPGA真可谓是大显神通,因为它们无需外设就可以进行计算、信号处理、高速通信还有其它功能。在一个FP....

  许多自组织系统本质上利用了确定性和随机过程的复杂混合。没有两棵树是完全相同的,因为生长是随机的,但是....

  Mouser分销的Terasic Atlas-SoC和DE0-Nano-SoC开发套件提供了基于Al....

  网络是数据中心里的交通枢纽,连接着所有运行应用业务的设备。没有网络,也就没有数据中心,没有互联网的今....

  即使在微调模式下,步进电动机的一个问题就是在启动和停止时它的输出存在振动,尽管在很多应用中这不算是个....

  借助SimpleLink SDK,工程师可以使用TI Drivers和功能性API来访问便携式和直观....

  FPGA是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物,它由输入/输出块、可配置逻....

  我刚刚开始修缮我的第一个PSoC项目,并且玩了(我希望的)可编程逻辑的简单版本。 不管怎样,从软件开发的背景来看,我习惯于...

  2017年12月,人工智能入选“2017年度中国媒体十大流行语”;2018年,AI爆发的元年。2019年,人工

  无论是无线还是有线数据通信,保持传输可靠性都是高质量解决方案的基本要求。

  两个量子比特可以对四个值执行操作,三个在八个值上执行操作,以此类推,两个幂 - 它们可以同时执行此操....

  网络化运动控制是未来运动控制的发展趋势,随着高速加工技术的发展,对网络节点间的时间同步精度提出了更高的要求。如造纸机械,...

  集成开发环境e² studio是一个完整的开发和调试环境,基于开源集成开发环境Eclipse框架而构....

  Embedded Target for RH850Multicore基于模型的开发环境的简介

  控制功能开发需要多周期控制,例如发动机控制中的进气/排气周期,燃油注入和点火周期以及车辆状态验证周期....

  近日,密歇根大学研发成功第一台可编程的忆阻器计算机,它不仅是一个通过外部计算机运行的忆阻器阵列,而且....

  Zynq UltraScale+ MPSoC器件可满足新一代5G系统不断提高的无线电和基带处理要求,....

  中国最大的搜索引擎提供商百度现已转用深度神经网络(DNN)处理技术来解决语音识别、图像搜索以及自然语....

  All Programmable 技术和器件的全球领先企业赛灵思公司(Xilinx, Inc. (N....

  现在,你可以通过阅读“对Xilinx Zynq-7000 All Programmable SoC中....

  ZCU106 评估套件可帮助设计人员为视频会议、监控、高级驾驶员辅助系统 (ADAS) 以及流媒体及....

  赛灵思扩展SmartConnect技术为16nm UltraScale+器件实现性能突破

  赛灵思 UltraScale+ 产品组合是业界唯一的一款基于 FinFET 的可编程技术。其包括 Z....

  在 SDSoC 中启动 Trace 后,事件追踪功能就会被自动插入到软件代码和硬件 IP 中。然后,....

  足当前计算密集型应用(如机器学习、数据分析和视频处理等)的需求。加上网络与存储方面日益明显的瓶颈,云....

  随着我们国家的不断发展,我们自主研发的科技产品,也都深得大家的喜爱。比如一些银行、餐厅、酒店等场合,....

  随着面向 Amazon EC2 F1 实例的 SDAccel 开发环境的部署,让不太熟悉 FPGA ....

  作者:张宇清 可编程逻辑器件(PLD)的两种主要类型是现场可编程门阵列(FPGA)和复杂可编程逻辑器件(CPLD)。根据半导...

  某些异构 SoC 面向多个器件级与系统级安全功能提供支持,便于轻松实现。这些器件能够对启动和配置过程....

  Zynq UltraScale+ MPSoC的多媒体功能和搭配其的处理引擎

  针对 UHD-4K 集成了支持 H.264/H.265 的视频编解码器单元,适用但不仅仅适用于监控、....

  此类 SD-FEC 功能通常在高性能 FPGA 的可编程逻辑中实现。随着为了支持数千兆位速率而进一步....

  最后,他们还简要介绍了近期发布的 RF 数据转换器评估工具。该工具与 ZCU111 评估套件共同运行....

  你好, 我要通过TRM,我没有发现很多关于固定功能块的解释。 经过几个章节,我得★△◁◁▽▼出结论,固定功能块是一组独立的可编程逻辑...

  SDSoC开发环境可提供高度简化、类似ASSP C/C++的编程体验,包括简便易用的Eclipse集....

  在大学期间,我和一些朋友在高级项目中首次尝试了嵌入式系统编程。我们制作了一个“物联网”(IoT)闹钟....

  许可软件开发工具集的昂贵可能会导致公司软件开发过程中出现瓶颈。独立调试器将有助于分配工作负载,以实现....

  专用集成电路(ASIC)采用硬接线的固定模式,而现场可编程门阵列 (FPGA)则采用可配置芯片的方法,二者差别迥异。可编程器件...

  现场可编程门阵列(FPGA)是一种可编程逻辑器件,最初几乎仅用于高性能系统设计的原型制作。量产时,F....

  ASIC设计工程师有着不错的职业前景,只要他们不会在需要提高技能水平的时候还“纹丝不动”。就像一个资深工程师所解释的那样...

  入选理由:开发第一个中文操作系统CCDOS,参与创办四通利方,掌控最大的中文网站新浪网技术总架构。 ...

  斯坦福大学开发出一种用于编程超级计算机的新语言Regent。用户可以先编程计算任务,然后•●再定位数据,....

  结构化编程、线性编程、模块化编程。对于西门子plc,以结构化编程为主,但可以使用线性编程和模块化编程....

  在 FPGA 设计方面,设计人员能够为运行特定工作负载开发自己的处理架构。FPGA 的一大重要优势就....

  FPGA市场在2008年是40亿美元规模,到了2016年还是40亿美元。似乎显而易见,当ASIC越来....

  一、数字电路的发展与可编程器件的出现 逻辑功能:通用型:54/74系列、74HC系列、74HCT系....

  影响力超高的Python入门书《Python编程无师自通——专业程序员的养成》

  《Python编程无师自通——专业程序员的养成》作者是一名自学成才的程序员,作为一名文科生他通过自学....

  在开始任何其他文字之前,首先有必要正视一个根本现实:国内外软件开发的水平是有差距的。

  硬件具有更长的开发周期,生产设计的时间表比您的设备实际上市销售要早得多。然而,对于软件来说,较短的开....

  TI将最新的电机控制开发与器件级软件驱动程序统一到一个产品中:C2000Ware MotorCont....

  将于2019年6月20日-21日在北京举办的NCDC网络与计算开发者大会(

乐彩论坛17500